Elección del Redriver o Retimer Adecuado para Extender el Alcance de Señales PCIe

Las soluciones redriver y retimer son esenciales para extender el alcance de señales PCIe® en sistemas modernos de computación y almacenamiento NVMe™. Esta guía explica cómo seleccionar el dispositivo óptimo para las cargas de trabajo de alto rendimiento de hoy y los estándares emergentes de mañana.

El empuje implacable hacia tasas de datos más altas en infraestructuras de computación en la nube y centros de datos pone demandas severas en la integridad de señal. A medida que el rendimiento sube, la distancia máxima de transmisión viable se reduce, limitando la escalabilidad del sistema. Tanto redrivers como retimers pueden mitigar estas pérdidas, sin embargo cada uno presenta compromisos distintos que deben entenderse antes del despliegue.

Este artículo proporciona un marco práctico para elegir entre un redriver o un retimer, detallando cómo cada tecnología extiende el alcance PCIe® y qué factores influyen en su idoneidad para entornos de computación y almacenamiento NVMe™.

El Desafío de Integridad de Señal PCIe

PCIe® sigue siendo la interfaz de alta velocidad dominante para servidores y redes de centros de datos. Sus tasas de datos han evolucionado desde Gen1 (2.5 GT/s) a Gen5 (32 GT/s), con Gen6 proyectado para duplicar eso nuevamente. Las frecuencias más altas requeridas para estas tasas exacerban la atenuación y dispersión en PCBs FR4 estándar, que siguen siendo el sustrato más económico pero sufren pérdida significativa por encima de 10 GHz.

Dieléctricos de mayor rendimiento como Megtron 6 ofrecen características de atenuación superiores —sin embargo pueden costar aproximadamente siete veces más que FR4. Para muchos diseños, la prima de costo supera los beneficios de calidad de señal. La Figura 1 ilustra cómo la atenuación escala con frecuencia para tanto FR4 como Megtron 6.

Donde:
W = ancho de traza en mil (5 mil usado en este ejemplo)
F = frecuencia en GHz
Df = factor de disipación (tangente de pérdida) del material PCB
Dk = constante dieléctrica del material PCB

Figura 1. Atenuación vs. Frecuencia para FR4 y Megtron 6

Los conectores contribuyen además a la pérdida —conectores PCIe CEM típicos añaden ~1.5 dB a 32 Gbps. El estándar PCIe Gen5 permite un presupuesto de pérdida de canal total de 36 dB, dejando margen limitado para pérdida de PCB y cable antes de que la degradación de señal sea inaceptable.

Redriver Explicado

Un redriver es un amplificador analógico de alto ancho de banda que usa un Ecualizador de Línea de Tiempo Continuo (CTLE) en el lado de recepción para contrarrestar atenuación dependiente de frecuencia. Pré‑énfasis opcional en el lado de transmisión puede dar forma a la forma de onda para mejorar el cierre de ojo. Como los redrivers son agnósticos al protocolo, carecen de lógica de entrenamiento de enlace y por tanto no pueden adaptarse a la secuencia de entrenamiento de enlace embebida de PCIe.

Los beneficios clave de un redriver son su bajo costo, consumo de potencia modesto e integración directa. Sin embargo, también amplifica todo el ruido de señal, añadiendo su propio piso de jitter —típicamente 8 ps de jitter intrínseco— y no puede corregir jitter no‑ISI. Los redrivers generalmente se limitan a enlaces PCIe Gen1–Gen3 y se vuelven imprácticos más allá de 16 Gbps debido a acumulación excesiva de ruido.

La Figura 2 muestra un diagrama de bloques típico de redriver de un solo canal.

Figura 2. Diagrama de bloques de redriver de un solo canal

Los Redrivers Tienen Sus Límites

Si bien un redriver puede extender longitudes de traza para sistemas Gen1–Gen3 de baja complejidad, falla en compensar la mayor atenuación y presupuestos de temporización más estrictos de enlaces Gen4 (16 Gbps) y Gen5 (32 Gbps). Cascadar múltiples redrivers es contraproducente porque cada etapa añade su propio ruido, duplicando efectivamente el presupuesto de jitter. Consecuentemente, los redrivers son inadecuados para cargas de trabajo de centro de datos que requieren enlaces PCIe de largo alcance a 16 Gbps o superior.

Retimer al Rescate

Comenzando con PCIe Gen4, el estándar exige explícitamente un retimer para enlaces de alta velocidad. Un retimer es consciente de la capa física e implementa lógica completa de entrenamiento y recuperación de enlace. Incluye un bloque de Recuperación de Reloj y Datos (CDR) que re‑extrae el reloj embebido, un par serializador/deserializador (SERDES) y un subsistema de monitoreo de ojo para diagnósticos en tiempo real.

La Figura 3 presenta un diagrama de bloques de alto nivel de un retimer bidireccional de un solo canal.

Figura 3. Diagrama de bloques de retimer

Los retimers típicos vienen en configuraciones x4, x8 o x16, proporcionando 4, 8 o 16 carriles físicos, respectivamente. Su arquitectura regenera completamente el flujo de datos, eliminando pérdida de inserción y preservando el presupuesto de jitter de la señal. Esta capacidad hace a los retimers indispensables para aplicaciones PCIe de alto rendimiento y largo alcance como SSDs NVMe, Ethernet 400 Gbps e interconexiones de aceleradores.

La Tabla 1 contrasta los atributos esenciales de redrivers y retimers.

Tabla 1. Comparación Redriver vs. Retimer

Ejemplos de Retimers en Aplicaciones PCIe

Los retimers son ahora un componente obligatorio en muchas topologías de centro de datos. La Figura 4 muestra una arquitectura típica de servidor donde un retimer se sitúa entre el complejo raíz de la CPU y el backplane o tarjeta add‑in, permitiendo expansión de señal sobre cables, tarjetas riser o switches adicionales.

Figura 4. Ejemplo de servidor con retimer PCIe

Configuraciones comunes incluyen:
• CPU ↔ Retimer ↔ Tarjeta Add‑in (AIC)
• CPU ↔ Retimer ↔ Tarjeta Riser ↔ AIC
• CPU ↔ Retimer ↔ Cable ↔ Switch ↔ AIC
• CPU ↔ Retimer ↔ Cable ↔ AIC

Figura 5. Retimer en tarjeta riser y placa base a AIC

En resumen, los redrivers aún pueden ser valiosos para diseños de baja velocidad y simples, pero para cualquier aplicación que requiera >16 Gbps —ya sea PCIe, USB 4.0 o Thunderbolt 3.0— los retimers proporcionan la regeneración de señal necesaria y cumplimiento con protocolos modernos de entrenamiento de enlace.

Referencias

1. High‑Speed Serial Bus Repeater Primer (PDF)
2. PCI‑SIG® Educational Webinar Series 2019 (PDF)
3. AN 766: Intel® Stratix® 10 Devices, High‑Speed Signal Interface Layout Design Guideline (PDF)
4. PCI Express Base Specification Revision 5.0, Version 1.0, 2019

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